drivers/gpu/drm/nouveau/nvkm/subdev/mc/gp100.c

   1 /*
   2  * Copyright 2012 Red Hat Inc.
   3  *
   4  * Permission is hereby granted, free of charge, to any person obtaining a
   5  * copy of this software and associated documentation files (the "Software"),
   6  * to deal in the Software without restriction, including without limitation
   7  * the rights to use, copy, modify, merge, publish, distribute, sublicense,
   8  * and/or sell copies of the Software, and to permit persons to whom the
   9  * Software is furnished to do so, subject to the following conditions:
  10  *
  11  * The above copyright notice and this permission notice shall be included in
  12  * all copies or substantial portions of the Software.
  13  *
  14  * THE SOFTWARE IS PROVIDED "AS IS", WITHOUT WARRANTY OF ANY KIND, EXPRESS OR
  15  * IMPLIED, INCLUDING BUT NOT LIMITED TO THE WARRANTIES OF MERCHANTABILITY,
  16  * FITNESS FOR A PARTICULAR PURPOSE AND NONINFRINGEMENT.  IN NO EVENT SHALL
  17  * THE COPYRIGHT HOLDER(S) OR AUTHOR(S) BE LIABLE FOR ANY CLAIM, DAMAGES OR
  18  * OTHER LIABILITY, WHETHER IN AN ACTION OF CONTRACT, TORT OR OTHERWISE,
  19  * ARISING FROM, OUT OF OR IN CONNECTION WITH THE SOFTWARE OR THE USE OR
  20  * OTHER DEALINGS IN THE SOFTWARE.
  21  *
  22  * Authors: Ben Skeggs
  23  */
  24 #define gp100_mc(p) container_of((p), struct gp100_mc, base)
  25 #include "priv.h"
  26
  27 struct gp100_mc {
  28         struct nvkm_mc base;
  29         spinlock_t lock;
  30         bool intr;
  31         u32 mask;
  32 };
  33
  34 static void
  35 gp100_mc_intr_update(struct gp100_mc *mc)
  36 {
  37         struct nvkm_device *device = mc->base.subdev.device;
  38         u32 mask = mc->intr ? mc->mask : 0, i;
  39         for (i = 0; i < 2; i++) {
  40                 nvkm_wr32(device, 0x000180 + (i * 0x04), ~mask);
  41                 nvkm_wr32(device, 0x000160 + (i * 0x04),  mask);
  42         }
  43 }
  44
  45 static void
  46 gp100_mc_intr_unarm(struct nvkm_mc *base)
  47 {
  48         struct gp100_mc *mc = gp100_mc(base);
  49         unsigned long flags;
  50         spin_lock_irqsave(&mc->lock, flags);
  51         mc->intr = false;
  52         gp100_mc_intr_update(mc);
  53         spin_unlock_irqrestore(&mc->lock, flags);
  54 }
  55
  56 static void
  57 gp100_mc_intr_rearm(struct nvkm_mc *base)
  58 {
  59         struct gp100_mc *mc = gp100_mc(base);
  60         unsigned long flags;
  61         spin_lock_irqsave(&mc->lock, flags);
  62         mc->intr = true;
  63         gp100_mc_intr_update(mc);
  64         spin_unlock_irqrestore(&mc->lock, flags);
  65 }
  66
  67 static void
  68 gp100_mc_intr_mask(struct nvkm_mc *base, u32 mask, u32 intr)
  69 {
  70         struct gp100_mc *mc = gp100_mc(base);
  71         unsigned long flags;
  72         spin_lock_irqsave(&mc->lock, flags);
  73         mc->mask = (mc->mask & ~mask) | intr;
  74         gp100_mc_intr_update(mc);
  75         spin_unlock_irqrestore(&mc->lock, flags);
  76 }
  77
  78 static const struct nvkm_mc_func
  79 gp100_mc = {
  80         .init = nv50_mc_init,
  81         .intr = gk104_mc_intr,
  82         .intr_unarm = gp100_mc_intr_unarm,
  83         .intr_rearm = gp100_mc_intr_rearm,
  84         .intr_mask = gp100_mc_intr_mask,
  85         .intr_stat = gf100_mc_intr_stat,
  86         .reset = gk104_mc_reset,
  87 };
  88
  89 int
  90 gp100_mc_new(struct nvkm_device *device, int index, struct nvkm_mc **pmc)
  91 {
  92         struct gp100_mc *mc;
  93
  94         if (!(mc = kzalloc(sizeof(*mc), GFP_KERNEL)))
  95                 return -ENOMEM;
  96         nvkm_mc_ctor(&gp100_mc, device, index, &mc->base);
  97         *pmc = &mc->base;
  98
  99         spin_lock_init(&mc->lock);
 100         mc->intr = false;
 101         mc->mask = 0x7fffffff;
 102         return 0;
 103 }